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使用verilog写的代码,在ISE综合时产生的警告中FSM_FFd6是什么意思

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解决时间 2021-03-20 20:05
使用verilog写的代码,在ISE综合时产生的警告中FSM_FFd6是什么意思
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因为你的逻辑中,不会用到state_2这一位,综合器发现他永远是0,就给优化掉了。

ffd是D触发器。追问state_2是我的状态寄存器的名字追答状态寄存器也会因为综合器分析你的逻辑之后,知道它永远是1或者永远是0,于是优化掉了

这种事情常有的
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警告不用管吧。
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